发布网友 发布时间:2023-09-20 11:45
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热心网友 时间:2024-11-17 22:25
T3周期的一开始,CPU检测READY引脚信号,若READY为低电平,则表示系统中挂接的存储器或外设不能如期送出数据,要求CPU在T3周期和T4周期之间插入一个或者几个等待周期Tw,如果READY为高电平,则进入T4周期。热心网友 时间:2024-11-17 22:26
不是很明白热心网友 时间:2024-11-17 22:26
一个最基本的总线周期由4个时钟周期组成,习惯上将4个时钟周期分别称为4个状态,即T1、T2、T3与T4这4个状态。当外设或存储器的速度较慢,不能及时地配合CPU传送数据时,外设或存储器就会通过READY的信号线在T3状态启动之前向CPU发一个“数据未准备好”信号,表示它们还来不及同CPU之间传送数据,于是,CPU会在T3之后自动插入1个或多个附加的时钟周期TW,这个TW就叫等待状态,它表示此时CPU在总线上的信息情况和T3状态时的信息情况一样。只有在指定的存储器或外设已经完成数据传送时,它们又通过READY的信号线向CPU发出一个“准备好”信号,当CPU接收到这一信号后,才会自动脱离TW状态而进入T4状态。