组合逻辑电路设计步骤

发布网友发布时间：2023-06-22 00:30

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热心网友时间：2024-04-15 05:43

组合逻辑电路设计步骤如下：

组合逻辑电路设计：从给定的逻辑要求出发，求出最简逻辑电路图。

一、组合逻辑电路设计的一般步骤

在数字电路中，根据逻辑功能的不同，我们可以将数字电路分成两大类，一类叫做组合逻辑电路、另一类叫做时序逻辑电路。本次主要讲解组合逻辑电路的原理、应用和Verilog实现。

二、组合逻辑电路特征：

（1）特定逻辑问题对应的真值表是唯一的；

（2）特定逻辑问题对应的逻辑表达式和逻辑电路可能由多种实现形式；

（3）设计原则是采用最简逻辑函数表达式，可得最简逻辑电路图；

（4）如果由于某些原因无法获得某些门电路，可以通过变换逻辑表达式来改变电路，从而能够使用已有的器件。

组合逻辑电路在逻辑功能上的特点是任意时刻的输出仅仅取决于该时刻的输入，与电路原来的状态无关。而时序逻辑电路在逻辑功能上的特点是任意时刻的输出不仅取决于当时的输入信号，而且还取决于电路原来的状态，或者说，还与以前的输入有关。

分析组合逻辑电路是根据给定的组合电路逻辑图，分析出其逻辑功能。首先要根据逻辑功能建立真值表，通过真值表写出逻辑函数表达式，再进行表达式化简，再根据化简后的函数表达式画出逻辑电路图。

但这样做，却往往会花费不少时间在化简上。利用无关项，无关项，指所对应的变量取值并不会出现在实际情况中的项。一般情况下，因为缺少定义，这些变量的值对应的输出无论是0还是1，都是合法的。利用无关项取变量不仅可以节省时间，而且有可能更优设计。