Xilinx ip核生成后,怎样在ModelSim中仿真?
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发布时间:2022-05-03 03:29
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热心网友
时间:2023-10-08 23:26
1,ModelSim可以直接编译和添加Xilinx的库,目前的ise中(在开始菜单xilinx工具下找吧)直接有使用ModelSim编译库的工具。完成库的编译之后,就是添加库到ModelSim的仿真环境中,修改modelsim安装目录下的modelsim.ini,这样就完成了库的添加,在仿真时,仅需要填加生成ip的.v文件。
2,tb自己编写是最好,xilinx 有些ip是有部分的tb的,但是这些tb仅仅是帮助你了解ip的使用,不具有实用价值,比如mac ddr等
这里附上我N年前编译仿真库的笔记,那个时候ModelSim和ise的版本都是很早的版本,不过原理还是一样的
先得把modelsim.ini改为可写
在命令行模式下运行:
"compxlib -s mti_se -l all -f all -p D:\Modeltech_6.1c\win32"
编译好的库放在:
D:\Xilinx\10.1\ISE\vhdl\mti_se
D:\Xilinx\10.1\ISE\verilog\mti_se
编译好之后,modelsim.ini 增加下面内容
UNISIMS_VER =d:\Xilinx\10.1\ISE\verilog\mti_se\unisims_ver
UNIMACRO_VER = d:\Xilinx\10.1\ISE\verilog\mti_se\unimacro_ver
UNI9000_VER =d:\Xilinx\10.1\ISE\verilog\mti_se\uni9000_ver
SIMPRIMS_VER =d:\Xilinx\10.1\ISE\verilog\mti_se\simprims_ver
XILINXCORELIB_VER =d:\Xilinx\10.1\ISE\verilog\mti_se\XilinxCoreLib_ver
AIM_VER = d:\Xilinx\10.1\ISE\verilog\mti_se\abel_ver\aim_ver
CPLD_VER =d:\Xilinx\10.1\ISE\verilog\mti_se\cpld_ver
SECUREIP =d:\Xilinx\10.1\ISE\verilog\mti_se\secureip
UNISIM = d:\Xilinx\10.1\ISE\vhdl\mti_se\unisim
UNIMACRO =d:\Xilinx\10.1\ISE\vhdl\mti_se\unimacro
SIMPRIM = d:\Xilinx\10.1\ISE\vhdl\mti_se\simprim
XILINXCORELIB =d:\Xilinx\10.1\ISE\vhdl\mti_se\XilinxCoreLib
AIM = d:\Xilinx\10.1\ISE\vhdl\mti_se\abel\aim
PLS = d:\Xilinx\10.1\ISE\vhdl\mti_se\abel\pls
CPLD = d:\Xilinx\10.1\ISE\vhdl\mti_se\cpld
热心网友
时间:2023-10-08 23:27
倒库!把Xilinx的库导到modelsim下面去!
Xilinx ip核生成后,怎样在ModelSim中仿真?
1,ModelSim可以直接编译和添加Xilinx的库,目前的ise中(在开始菜单xilinx工具下找吧)直接有使用ModelSim编译库的工具。完成库的编译之后,就是添加库到ModelSim的仿真环境中,修改modelsim安装目录下的modelsim.ini,这样就完成了库的添加,在仿真时,仅需要填加生成ip的.v文件。\x0d\x0a2,tb自己编写...
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展开它可以看到“Compile HDL Simulation Libraries”,双击它即可自动编译 ISE 的库(要确保 Process属性窗口中“Target Simulator”正确设置为“Modelsim SE”,如图附 2);编译好的库放在$Xilinx/Verilog/mti_se/ 下(在 modelsim中仿真 ip 核需添加库时指向该路径即可,...
如何仿真IP核
1. 在 ISE 集成环境中仿真 IP核 IP 核应该在新建的工程中进行仿真与例化;在原工程中可以例化使用,但好像不能直接对它加 testbench 后进行仿真。如下两图所示。2.在 modelsim中仿真 ip 核 a.在 modelsim中编译库(Xiliinx) (1)在$Modeltech_6.0d/Xilinx_lib_tt下新建文件夹 Xilinx_lib...
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生成后自带一个.mif文件,modelsim中不需要添加.mif 文件即可仿真。顺带提下:xilinx ip core在modelsim中仿真不同于altera的。还需要建个xilinx的library。如果需要可以+在问题描述里面。
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第一步:用modelsim编译xilinx的库,并添加;第二步:打开ISE,edit——>preference,在第三方仿真工具里添加你安装modelsim的目录;第三步:打开你要仿真的ISE工程,在“source”窗口上面有一个下拉菜单,菜单有“behavioral simulation”以及“post synthesis simulation”等,选最后一个第四步:现在在source窗口,你应该能够看到...
求助:利用MODELSIM仿真XILINX的FIFO核
添加xilinx.lib库就可以了 路径在安装modelsim的文件夹下
xilinx 库问题。。。我已经编译过了,但是modelsim后仿真时候出现了这个...
你转换成门级网络的时候文件缺省了上述的子程序。你在库里找到贴到门级文件后面再仿就可以了。。。
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首先需要将.bdf原理图文件转换为Verilog HDL等第三方EDA工具所支持的标准描述文件。在Quartus下,保持*.bdf为活动窗口状态,运行[File]/[Create/Update]/[Create HDL Design File for Current File]命令,在弹出窗口选择文件类型为Verilog HDL,即可输出*.v顶层文件。Altera的基本宏功能的功能(行为)仿真...
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